数字电路逻辑与设计实验三 译码器和数据选择器

数字电路逻辑与设计
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一、实验目的和要求

实验目的:

1.熟悉集成译码器。

2.了解集成译码器应用。

实验要求:

1.掌握译码器的功能测试及转换。

2.了解数据选择器的应用。

二、实验环境

数字电路实验箱

三、实验内容与过程

  1. 译码器功能测试 将 74LS139 按图 3.1 接线,按表 3.2 输入电平分别置位,填输出状态表。

VIP 实验报告二 分别用数据选择器和译码器设计全加器 将Decoder的三个输入引脚A2,A1,A0分别连接到全加器的输入变量A,B,Cin上,再将Decoder的输出引脚Y1,Y2,Y4,Y7连接到一个或门的输入引脚上,该或门的输出引脚即为全加器本位和S的输出,最后将Decoder的输出引脚Y3,Y5,Y6,Y7连接到另一个或门输入引脚上,该或门门的输出引脚即为进位位Cout的输出。当A=1,B=0时S=/Cin,所以D2=/Cin;将全加器的输入变量A,B分别连接到四选一选择器的地址输入端A1,A0,通过寻找到输入A,B,Cin与输出之间的关系实现降维。 开通可读全文·2.6k 阅读·30 点赞·46 收藏 阅读全文

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