CDR学习笔记——02

VIPCDR学习笔记——02
这篇写一些高级CDR的架构原理。
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这篇写一些高级CDR的架构原理

1.半速鉴相器

很明显,如过能用半速时钟替代全速时钟,这肯定是赚。另外,在高速场景下,(1)、高速时钟的相噪难以控制,(2)、高速时钟要组成时钟树,(3)、设计高速触发器。以上问题都不好搞,所以要设计半速架构

1.1半速BBPD


Ex1

原先的半速亚历山大鉴相器,能否直接在半速时钟下工作?

答:很明显不大行,因为在原本的电路中,需要三个边沿工作,而现在变为半速时钟,直接少了一个采样点,所以很明显不行。


很明显,如果想在半速时钟下实现亚历山大结构,就需要一组正交时钟实现三点采样。

这里的FF1和FF3由互补的半速率时钟驱动,实际上充当了解复用器


EX2

图14.2(b)中的半速率相位检测器是否会清晰的采集每个数据边沿的信息?

答:并不会,因为CKq的下降沿并不采集信息,所以会丢失Din的下降沿信息。


为了补充上面所分析出的,会丢失下降沿的问题,我们可以额外增加一个触发器,并直接由CKq驱动,并做互补运算,如下图所示

VIP 拆解一篇CDR设计经典论文 这里要注意delay,Tword * Nel需要控制,不能接近1/4/Funity_gain. Tword为CDR数字的工作时钟周期,Nel为延时的个数,Funity_gain为CDR的带宽。,从而推出Z^(-1) =Z^(-ST) 约等于1-sT或者1-sT+s^2 T^2 /2,T为采样周期,ST远小于1.一般CDR和PLL的带宽远小于fs,因此一般系统就可以用Z^(-1)=1-ST 得到S=(1-z^(-1))/T,把这个式子带入上面的传输函数,就可以把S 域转换到Z域中去,得到下面的Z域传输函数。 开通可读全文·1.7k 阅读·44 点赞·14 收藏 阅读全文

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