ECO即engineer change order，即工程变更指令，可以对设计做局部小改动并只对改动部分重新布局布线并生成.bit。在一个工程动辄编译几个小时情况下，可以在调试中节省大量时间。比如我们在调试中，需要改变时钟占空比或者相位，需要改变寄存器初值等等，此时用ECO暂时改动，待验证后在重新编译无疑是最有效率的方法。
实现ECO通常有两种方式，一是通过vivado界面完成，另一种方法就是tcl脚本。所有的ECO操作都可以通过tcl操作完成，有的操作用vivado界面无法完成，只能通过tcl。以下主要介绍通过界面修改属性。
在工程实现后，调试过程中发现需要修改某个经MMCM产生的时钟相位，从0都改为90都，步骤如下：
1）打开实现的设计open implementation design，并找到相应的mmcm模块，按F4即可出现schematic视图
2）选中mmcm_adc_inst模块，在cell_properties（如果没有出现，右键即可找到cell properties）
找到CLKOUT0_PHASE，默认值为0，我们直接改为90即可
3）保存
Vivado开发技巧
Vivado是Xilinx系列FPGA开发环境。本文记载收录了各种vivado工具的使用方法。
Vivado ECO实战：5分钟搞定MMCM时钟相位修改（附TCL命令）
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Vivado ECO实战：利用TCL脚本高效修改时钟属性与生成.bit文件
本文详细介绍了在Vivado开发环境中，如何高效运用ECO（工程变更指令）技术进行FPGA设计调试。重点阐述了通过TCL脚本自动化修改时钟属性（如MMCM相位）并直接生成.bit文件的核心流程，相比传统完整编译可节省大量时间，是提升硬件开发效率的关键实践。
Vivado调试省时技巧：不用重新综合就能生成.bit文件的完整流程
本文详细介绍了在Vivado开发环境中，如何利用ECO（工程变更指令）技术，在不重新综合整个设计的情况下，快速生成.bit文件。通过GUI和Tcl脚本两种方式，演示了修改时钟相位等参数的具体流程，旨在帮助FPGA开发者大幅缩短调试迭代时间，提升工作效率。
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Vivado ECO模式实战：快速替换ILA调试信号的高效技巧
本文详细介绍了Vivado ECO模式在FPGA调试中的高效应用，重点讲解如何快速替换ILA调试信号以节省时间。通过获取正确的DCP文件、进入ECO模式、信号替换全流程及生成新调试文件等步骤，帮助开发者将原本数小时的调试工作缩短至10分钟内。文章还提供了处理特殊情况的技巧和性能优化建议，是FPGA开发者的实用指南。
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