STA | 4. Latch应用总结!附Time Borrowing,Lockup,Clock Gating Check概念解析

latch应用总结-Time Borrowing/Lockup/Gating Check 同步数字电路中主流还是用寄存器,但是锁存器(Latch)也不容忽视,它既能用作数据存储单元,又能作为时钟控制单元。 阅读详情

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你好,我是老本(Benjamin)。

前几篇STA文章谈到,同步数字电路中的Path主流还是用寄存器,但是锁存器(Latch)相关的Path也不容忽视,它既能用作数据存储单元,又能作为时钟控制单元。这一篇就讲讲Latch的功能,相关的Timing Path如何分析,其中也会涉及到 time borrowing, lockup, clock gating check等概念。

Latch功能

Latch的电路结构如下图:

在这里插入图片描述
Latch电路结构

当 E = 1 时,latch直传(transparent),D端信号的变化会即时反应在Q端;
当 E = 0 时,latch关断(closed),Q端保持关断瞬间D端的值。

设计中使用Latch的好处是,相比寄存器的面积更小,功耗更低,可以从后级电路进行time borrowing,更容易满足setup time,然而坏处是STA分析不会那么直接,下面我们就看看引入了Latch的Timing Path如何分析。

Time Borrowing

在数字设计中,

ICG setup timing violation介绍? 门控时钟(clock gating)在RTL级电路设计过程中进行低功耗优化常用方法,能够有效降低动态功耗(翻转功耗)。Clock gating cell 可以由与门,与非门,或门或者或非门构成,但很容易产生Glitch。在实际使用中,一般用ICG(集成门控时钟单元)来完成clock gating。 下图展示了glitch的产生原因 在CTS时钟树综合的时候,ICG不会被看作sink,通常放置在source点附近,因此就会出现如上图这种结果。上图可以看出,在分析DFF到ICG的setup timing 阅读详情

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