【芯片设计- RTL 编译与仿真 1.2 -- Visualizer 常用使用命令】

芯片设计 RTL 数字逻辑设计扫盲
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Visualizer

Visualizer 是由Mentor, A Siemens Business(现为Siemens EDA)开发的一个综合调试环境,旨在提供一套完整的解决方案来满足复杂SoC(System-on-Chip)和FPGA(Field-Programmable Gate Array)设计的验证需求。Visualizer 结合了波形查看、源代码调试和覆盖率分析等多个功能,提供了一个高效的环境来优化验证流程。

Visualizer 特点和功能

  • 高效的调试工具:包括波形分析、比较工具以及能够直观展示源代码和波形之间关联的调试工具。
  • 组合多种验证技术:Visualizer 结合了传统的仿真、形式验证和静态分析技术,为用户提供了一个统一的调试视图。
  • 定制化视图:允许用户根据需要定制波形视图和分析报告,提高了验证的灵活性和效率。
  • 跨平台支持:支持多种操作系统,包括 Windows 和 Linux,增加了工具的适用性。

Verdi 全局显示

bsubi -n 16 -J sam visualizer -tracedir ./veloce.wave/debug_waveform.stw 打开波形后,如果想要看到所有信号的数据,可以点

VIP Verdi快速使用技巧 目录 1.加载设计 2.加载波形 3.重新加载设计和波形 4.选择信号 5.查看波形 6.mark标记时间差 7.波形文件保存 *.rc 8.获取参数值 9.获取波形时刻里的值 10.新建组与对组重命名,显示信号全路径 11、改变信号和波形颜色 12.查看信号及变化 13.显示状态机及其名称 1.加载设计 veidi加载设计的脚本 run_verdi: verdi -sv -f tb_top_filelist.f -top tb_top & 告知软件... 开通可读全文·2.5w 阅读·36 点赞·453 收藏 阅读全文

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